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-- Copyright (C) 1991-2010 Altera Corporation
-- Your use of Altera Corporation's design tools, logic functions
-- and other software and tools, and its AMPP partner logic
-- functions, and any output files from any of the foregoing
-- (including device programming or simulation files), and any
-- associated documentation or information are expressly subject
-- to the terms and conditions of the Altera Program License
-- Subscription Agreement, Altera MegaCore Function License
-- Agreement, or other applicable license agreement, including,
-- without limitation, that your use is for the sole purpose of
-- programming logic devices manufactured by Altera and sold by
-- Altera or its authorized distributors. Please refer to the
-- applicable agreement for further details.
--
-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
-- DNU : Do Not Use. This pin MUST NOT be connected.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- Bank 3: 3.3V
-- Bank 4: 3.3V
-- Bank 5: 3.3V
-- Bank 6: 3.3V
-- Bank 7: 3.3V
-- Bank 8: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. For transceiver I/O banks, connect each pin marked GND*
-- either individually through a 10k Ohm resistor to GND or tie all pins
-- together and connect through a single 10k Ohm resistor to GND.
-- For non-transceiver I/O banks, connect each pin marked GND* directly to GND
-- or leave it unconnected.
-- RESERVED : Unused I/O pin, which MUST be left unconnected.
-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.
-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.
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-- Pin directions (input, output or bidir) are based on device operating in user mode.
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Quartus II 64-Bit Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Full Version
CHIP "g04_lab03" ASSIGNED TO AN: EP2C20F484C7
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
GND : A1 : gnd : : : :
VCCIO3 : A2 : power : : 3.3V : 3 :
I2C_SCLK : A3 : output : 3.3-V LVTTL : : 3 : Y
AUD_BCLK : A4 : output : 3.3-V LVTTL : : 3 : Y
AUD_DACLRCK : A5 : output : 3.3-V LVTTL : : 3 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : A6 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A7 : : : : 3 :
segment3[0] : A8 : output : 3.3-V LVTTL : : 3 : N
segment3[1] : A9 : output : 3.3-V LVTTL : : 3 : N
volume[0] : A10 : input : 3.3-V LVTTL : : 3 : N
RESERVED_INPUT_WITH_WEAK_PULLUP : A11 : : : : 3 :
GND+ : A12 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A13 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A14 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A15 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A16 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A17 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A18 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A19 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : A20 : : : : 4 :
VCCIO4 : A21 : power : : 3.3V : 4 :
GND : A22 : gnd : : : :
VCCIO1 : AA1 : power : : 3.3V : 1 :
GND : AA2 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : AA3 : : : : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AA4 : : : : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AA5 : : : : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AA6 : : : : 8 :
octave[2] : AA7 : input : 3.3-V LVTTL : : 8 : N
segment1[5] : AA8 : output : 3.3-V LVTTL : : 8 : N
segment1[6] : AA9 : output : 3.3-V LVTTL : : 8 : N
RESERVED_INPUT_WITH_WEAK_PULLUP : AA10 : : : : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AA11 : : : : 8 :
FL_ADDR[15] : AA12 : output : 3.3-V LVTTL : : 7 : Y
FL_ADDR[13] : AA13 : output : 3.3-V LVTTL : : 7 : Y
FL_ADDR[1] : AA14 : output : 3.3-V LVTTL : : 7 : Y
FL_OE_N : AA15 : output : 3.3-V LVTTL : : 7 : Y
FL_DQ[1] : AA16 : bidir : 3.3-V LVTTL : : 7 : Y
FL_DQ[3] : AA17 : bidir : 3.3-V LVTTL : : 7 : Y
FL_DQ[5] : AA18 : bidir : 3.3-V LVTTL : : 7 : Y
FL_DQ[7] : AA19 : bidir : 3.3-V LVTTL : : 7 : Y
FL_ADDR[17] : AA20 : output : 3.3-V LVTTL : : 7 : Y
GND : AA21 : gnd : : : :
VCCIO6 : AA22 : power : : 3.3V : 6 :
GND : AB1 : gnd : : : :
VCCIO8 : AB2 : power : : 3.3V : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AB3 : : : : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AB4 : : : : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AB5 : : : : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AB6 : : : : 8 :
note[0] : AB7 : input : 3.3-V LVTTL : : 8 : N
segment1[4] : AB8 : output : 3.3-V LVTTL : : 8 : N
segment3[6] : AB9 : output : 3.3-V LVTTL : : 8 : N
RESERVED_INPUT_WITH_WEAK_PULLUP : AB10 : : : : 8 :
RESERVED_INPUT_WITH_WEAK_PULLUP : AB11 : : : : 8 :
FL_ADDR[16] : AB12 : output : 3.3-V LVTTL : : 7 : Y
FL_ADDR[14] : AB13 : output : 3.3-V LVTTL : : 7 : Y
FL_ADDR[12] : AB14 : output : 3.3-V LVTTL : : 7 : Y
FL_CE_N : AB15 : output : 3.3-V LVTTL : : 7 : Y
FL_DQ[0] : AB16 : bidir : 3.3-V LVTTL : : 7 : Y
FL_DQ[2] : AB17 : bidir : 3.3-V LVTTL : : 7 : Y
FL_DQ[4] : AB18 : bidir : 3.3-V LVTTL : : 7 : Y
FL_DQ[6] : AB19 : bidir : 3.3-V LVTTL : : 7 : Y
FL_ADDR[0] : AB20 : output : 3.3-V LVTTL : : 7 : Y
VCCIO7 : AB21 : power : : 3.3V : 7 :
GND : AB22 : gnd : : : :
VCCIO2 : B1 : power : : 3.3V : 2 :
GND : B2 : gnd : : : :
I2C_SDAT : B3 : output : 3.3-V LVTTL : : 3 : Y
AUD_MCLK : B4 : output : 3.3-V LVTTL : : 3 : Y
AUD_DACDAT : B5 : output : 3.3-V LVTTL : : 3 : Y
RESERVED_INPUT_WITH_WEAK_PULLUP : B6 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B7 : : : : 3 :
note[3] : B8 : input : 3.3-V LVTTL : : 3 : N
segment2[5] : B9 : output : 3.3-V LVTTL : : 3 : N
RESERVED_INPUT_WITH_WEAK_PULLUP : B10 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B11 : : : : 3 :
GND+ : B12 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B13 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B14 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B15 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B16 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B17 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B18 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B19 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : B20 : : : : 4 :
GND : B21 : gnd : : : :
VCCIO5 : B22 : power : : 3.3V : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C1 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C2 : : : : 2 :
~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : C3 : input : 3.3-V LVTTL : : 2 : N
~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : C4 : input : 3.3-V LVTTL : : 2 : N
GND : C5 : gnd : : : :
VCCIO3 : C6 : power : : 3.3V : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C7 : : : : 3 :
GND : C8 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : C9 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C10 : : : : 3 :
VCCIO3 : C11 : power : : 3.3V : 3 :
VCCIO4 : C12 : power : : 3.3V : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C13 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C14 : : : : 4 :
GND : C15 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : C16 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C17 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C18 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C19 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C20 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C21 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : C22 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D1 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D2 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D3 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D4 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D5 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D6 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D7 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D8 : : : : 3 :
segment1[0] : D9 : output : 3.3-V LVTTL : : 3 : N
GND : D10 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : D11 : : : : 3 :
clk_50 : D12 : input : 3.3-V LVTTL : : 3 : N
GND : D13 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : D14 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D15 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D16 : : : : 4 :
VCCIO4 : D17 : power : : 3.3V : 4 :
GND : D18 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : D19 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D20 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : D21 : : : : 5 :
volume[1] : D22 : input : 3.3-V LVTTL : : 5 : N
RESERVED_INPUT_WITH_WEAK_PULLUP : E1 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E2 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E3 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E4 : : : : 2 :
VCCD_PLL3 : E5 : power : : 1.2V : :
VCCA_PLL3 : E6 : power : : 1.2V : :
RESERVED_INPUT_WITH_WEAK_PULLUP : E7 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E8 : : : : 3 :
segment4[5] : E9 : output : 3.3-V LVTTL : : 3 : N
VCCIO3 : E10 : power : : 3.3V : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E11 : : : : 3 :
rst : E12 : input : 3.3-V LVTTL : : 3 : N
VCCIO4 : E13 : power : : 3.3V : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E14 : : : : 4 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E15 : : : : 4 :
GNDA_PLL2 : E16 : gnd : : : :
GND_PLL2 : E17 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : E18 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E19 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E20 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E21 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : E22 : : : : 5 :
RESERVED_INPUT_WITH_WEAK_PULLUP : F1 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : F2 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : F3 : : : : 2 :
RESERVED_INPUT_WITH_WEAK_PULLUP : F4 : : : : 2 :
GND_PLL3 : F5 : gnd : : : :
GND_PLL3 : F6 : gnd : : : :
GNDA_PLL3 : F7 : gnd : : : :
RESERVED_INPUT_WITH_WEAK_PULLUP : F8 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : F9 : : : : 3 :
RESERVED_INPUT_WITH_WEAK_PULLUP : F10 : : : : 3 :
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RESERVED_INPUT_WITH_WEAK_PULLUP : F12 : : : : 4 :
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FL_ADDR[2] : Y16 : output : 3.3-V LVTTL : : 7 : Y
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